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CPLD Firmware
Appendix A
CPLD Firmware
/* Copyright 2005, All Rights Reserved, Freescale Semiconductor, Inc. */
/****************************************************************************
PROJECT : MSC711xPFC Revision 2 CPLD (Xilinx XC9572XL-10TQG100C)
MODULE : TOPLEVEL
NOTES
: All bus control signals are active-low (CS, DS, RW, etc.).
AUTHOR
: David M. Koltak
10/17/2005
VER DATE AUTHOR -DESCRIPTION
-----------------------------------------------------------------------------
0.1 10/17/2005 David M. Koltak -Initial Design
1.0 10/18/2005 David M. Koltak -Compiles without warnings or errors
1.1 10/19/2005 David M. Koltak -IDMA Mode, BM Reset I2C, Clock Loop
1.2 10/19/2005 David M. Koltak -Changed BM0 so default=0, output=1
1.3 11/07/2005 David M. Koltak -Changed default BM back to 0x0
-Changed clock assignments
2.0 01/30/2006 David M. Koltak -Changed HDREQ equations
-Added Firmware Version Register
-Removed IDMA Mode
3.0 04/19/2006 David M. Koltak -Updated for production boards (V2.7)
****************************************************************************/
‘define BOARD_VERSION 2’d1
‘define MAJOR_VERSION 3’d3
‘define MINOR_VERSION 3’d0
module TOPLEVEL
(
CLKIN,
DSP_CLKIN,
PORESET,
GOOD_3V3,
GOOD_5V,
LED,
EONCE_HRESET,
DSP_HRESET,
DSP_BM0,
DSP_BM,
DSP_SWTE,
DSP_DBREQ,
DSP_HTRQ,
DSP_HRRQ,
HDREQ,
DSP_HA,
HA_DSP,
MSC711x Packet Telephony Farm Card (SPT711xPFCE), Rev. 1
30
Freescale Semiconductor
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